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基于MATLAB的RISC-V的片上系统开发

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发表于 2020-9-2 19:47:54 | 显示全部楼层 |阅读模式
基于MATLAB的RISC-V的片上系统开发,基于此系统结合MATLAB代码自动生成技术,进行RISC-V的FPGA开发,以及对应的MCU C语言发开,提供完整的开发工具链,轻松完成RISC-V的个性定制,并快速完成MCU的C语言开发。
本工具箱将首先在荔枝糖Anlogic EG4S20系列FPGA上实现(国产FPGA,性价比超高),进而推广到Inteal,xilinx的FPGA。首版的RISC-V将以蜂鸟E203(RV32IMAC)为模板,在修改蜂鸟E203的源代码,配合MATLAB的Verilog代码生成,从而轻松定制属于自己的RISC-V内核。
并且与之匹配的MCU开发也将一并提供。




蜂鸟E203 MCU SoC 为蜂鸟E203 处理器核配套的MCU 级别SoC,其特性概述如下。
(1)使用全开源的蜂鸟E203 处理器核。
• 超低功耗 2 级流水线处理器核。
• 大小可配置的 ITCM 和DTCM。
(2)为了更大程度上共享当前HiFive1 开发板的软件生态,蜂鸟E203 MCU SoC 尽可能
地复用SiFive 公司开源的Freedom 310(HiFive1 开发板所使用)SoC IP,包括:
• 对已有的 IP 进行复用兼容。
• 对总线地址分配进行兼容。
(3)在兼容Freedom 310 SoC 的基础上,增加如下IP,使其SoC 功能更加完整。
• I2C Master 接口。

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 楼主| 发表于 2020-9-5 10:03:45 | 显示全部楼层
首先构建RISC-V的板级支持包,这是控制整个代码生成的关键文件,也成为系统级tlc文件。
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 楼主| 发表于 2020-9-5 13:15:36 | 显示全部楼层
构建RISC-V MCU的内核配置以及工程代码生成工具
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 楼主| 发表于 2020-9-5 14:45:57 | 显示全部楼层
能够自动生成eclipse工程,并且已自动配置好相应的工具链。可以直接编译烧写调试!
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 楼主| 发表于 5 天前 | 显示全部楼层
首先用户能够通过Simulink,设计自己的外设挂到总线上,总线将支持ICB  AXI  APB。
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